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작성자 윤남희
댓글 0건 조회 1회 작성일 26-05-13 15:46

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Verify Design으로 clearance connectivity 체크시 via 홀이 배선을 뚫고 지나갔는데도 오류가 안잡히는 경우가 있는데 혹시 세팅해야 하는 것이 있나요?

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